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基于Vivado的FPGA高性能开发
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田老师
工学博士,毕业于北京邮电大学信号与信息处理专业
 
时间地点: 北京、上海、深圳根据报名开班
课程费用:4000元/人
 
企业内训:可以根据企业需求,定制内训,详见 内训学习手册



认证方式:
培训前了解能力模型。
培训后进行能力评测:
  • 在线考试
  • 能力分析,给出学习建议
  • 合格者颁发证书,作为职业技能资格证明


    课程内容结合了国外同类培训课程内容和培训讲师的科研教学实践,理论丰富,实验合理,具有非常强的系统性和实用性,可以引导学员快速提高FPGA数字系统设计水平,更快创建设计,缩短开发时间,降低开发成本。
    培训目标:
    • 了解7系列和Ultrascale的FPGA特征
    • 掌握Vivado入门实践
    • 掌握UltraFast 设计方法
    • 掌握Tcl脚本开发
    培训对象:课程适合于FPGA器件进行科研和产品开发具有中等以上水平及对7系列FPGA有一定了解及熟悉的工程技术人员,也适合于相关专业领域具有相当水平的教师和研究生。
    学员基础:了解电路基本知识,最好具备一定的硬件开发经验,
    授课方式:定制课程 + 案例讲解 + 小组讨论,60%案例讲解,40%实践演练
    培训内容:2天

    7系列和Ultrascale的FPGA特征
    • 7系列和Ultrascale的FPGA电源、配置电路;
    • 7系列和Ultrascale的FPGA管脚分配策略;
    • 7系列和Ultrascale的FPGA系统设计方法和策略,
    • 时钟和管脚分配技巧;
    • 7系列和Ultrascale的FPGA和ZYNQ系统注意事项;
    • 典型工程实例剖析;
    Vivado入门实践
    • Vivado先进性说明以及开发模式;
    • Vivado环境下时序与管脚约束XDC说明与实例;
    • Vivado代码管理模式;
    • Vivado开发流程:创建工程、IP核、仿真、综合、实现、下载以及硬件调试;
    • Vivado FPGA验证工具,平面视图、时序分析、脚本技术等高级设计方法;
    • 基于Vivado的加密可靠性设计;
    • 用户自定义IP核的开发、集成和调用;
    • 典型实例辅助设计;
    UltraFast 设计方法
    • 管脚分配和PCB板卡设计建议;
    • FPGA代码建议技巧,涉及最基本的寄存器、状态机、调试逻辑、ROM和RAM以及DSP架构;
    • 参数、属性和约束的综合使用,打造可维可测的高效代码;
    • Vivado设计和实现策略以及自顶向下/自下向上设计流程剖析,简要说明传统模式和动态可重构差异;
    • 综合、实现属性以及脚本相结合的高效FPGA设计方法;
    Tcl脚本开发
    • Tcl语言基础,包括Tcl背景和语法、在Vivado IDE使用Tcl脚本、Tcl的“钩子”脚本;
    • 基于Tcl定制Vivado实现流程:用Tcl定制实现流程、增量流程设计;
    • 基于Tcl的工程模式开发流程;
    • 基于Tcl的无工程模式开发流程;
     
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     讲座 数据治理
     讲师:王辉
     时间:2019-10-19
     
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